FPGA: la suite

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La date : le vendredi 27 mars de 17h à 23h30, ou le samedi 28 mars de 9h à 15h30. Les votes sont ouverts sur http://www.dispoo.com/ViewPoll.aspx?IDPOLL=d0979de8-55e4-461d-b2fb-1025660ee383
 
Voici les différents points qui seront abordés:
Voici les différents points qui seront abordés:
# Utilisation des outils en ligne de commande
# Utilisation des outils en ligne de commande
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# Introduction à Verilog (maintenant que vous etes en mesure d'apprécier
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# Introduction à Verilog
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délicatement son utilité)
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# Survol de VHDL
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# Simulation
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# Hands-on: à peu près les memes + petit synthétiseur audio en utilisant les boutons
# Hands-on: à peu près les memes + petit synthétiseur audio en utilisant les boutons
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S'il reste du temps :
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# Simulation
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# Survol de VHDL
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Les fichiers sont dispo ici : http://lekernel.net/presentations/FPGA_Workshops/
== Connaissances nécessaires ==
== Connaissances nécessaires ==
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== Inscrits/Attendees ==
== Inscrits/Attendees ==
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Le Mono: lekernel
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* Le Mono: lekernel
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Les autres: merci de vous inscrire sur
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Cf:
http://www.dispoo.com/ViewPoll.aspx?IDPOLL=d0979de8-55e4-461d-b2fb-1025660ee383
http://www.dispoo.com/ViewPoll.aspx?IDPOLL=d0979de8-55e4-461d-b2fb-1025660ee383
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NB. Les votes sont terminés, mais vous pouvez toujours vous inscrire pour le samedi.
== Recommandé ==
== Recommandé ==
* Pareil que pour le workshop précédent
* Pareil que pour le workshop précédent
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* Icarus Verilog, GPL CVer, GHDL, GTKWave
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* En plus: Icarus Verilog, GPL CVer, GHDL, GTKWave
* on a moins de temps que la dernière fois donc faites correctement vos devoirs bande de cancres
* on a moins de temps que la dernière fois donc faites correctement vos devoirs bande de cancres
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* Petits haut-parleurs (HP seuls) ou prises Jack pour casques (femelles), et résistances 220 Ohm non CMS.
* Petits haut-parleurs (HP seuls) ou prises Jack pour casques (femelles), et résistances 220 Ohm non CMS.
* Barrettes HE10 femelles pour pouvoir se brancher proprement sur le connecteur à gauche de http://blog.nirosoftware.com/wpblog/wp-content/uploads/2008/11/avnet_xilinxspartan_3a.jpg.
* Barrettes HE10 femelles pour pouvoir se brancher proprement sur le connecteur à gauche de http://blog.nirosoftware.com/wpblog/wp-content/uploads/2008/11/avnet_xilinxspartan_3a.jpg.
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= Support =
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== Compilation ==
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* cver <--- used by Lekernel
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* iverilog (icarus verilog)
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== Simulation ==
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Visualisation des VCD (VCD viewers):
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* GTK Wave
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* Dinotrace
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== wire vs reg ==
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* assign : utilise toujours des wires
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* always : utilise toujours des regs (pour Xreg = ...)
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[[Category:Workshop]]
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Current revision

  • Titre: FPGA: La suite
  • Par: lekernel
  • Date: Samedi 28 mars de 9h à 15h30
  • Lieu: /tmp/lab

Introduction à Verilog


Contents

Workshop FPGA

Voici les différents points qui seront abordés:

  1. Utilisation des outils en ligne de commande
  2. Introduction à Verilog
  3. Hands-on: à peu près les memes + petit synthétiseur audio en utilisant les boutons

S'il reste du temps :

  1. Simulation
  2. Survol de VHDL

Les fichiers sont dispo ici : http://lekernel.net/presentations/FPGA_Workshops/

Connaissances nécessaires

Avoir suivi le workshop précédent: Workshop_Introduction_aux_FPGA

Inscrits/Attendees

  • Le Mono: lekernel

Cf: http://www.dispoo.com/ViewPoll.aspx?IDPOLL=d0979de8-55e4-461d-b2fb-1025660ee383

NB. Les votes sont terminés, mais vous pouvez toujours vous inscrire pour le samedi.

Recommandé

  • Pareil que pour le workshop précédent
  • En plus: Icarus Verilog, GPL CVer, GHDL, GTKWave
  • on a moins de temps que la dernière fois donc faites correctement vos devoirs bande de cancres

How To: Ces outils sont généralement disponibles via votre gestionnaire de paquetages préféré et il y a aussi des portages via Cygwin pour ceux qui aiment les OS propriétaires. Sous Debian et dérivés :

apt-get install verilog gplcver ghdl gtkwave

Icarus sous Win: http://bleyer.org/icarus/

Equipement

Dispo :

Wanted :

Support

Compilation

  • cver <--- used by Lekernel
  • iverilog (icarus verilog)

Simulation

Visualisation des VCD (VCD viewers):

  • GTK Wave
  • Dinotrace

wire vs reg

  • assign : utilise toujours des wires
  • always : utilise toujours des regs (pour Xreg = ...)
Personal tools